Puerta OR

Circuitos. Tablas verdad. Entrada, salida. Valores lógicos. Puertas AND, NAND, NOR DTL. Lógica negativa. Inversora. Transistor

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MONTAR EL CIRCUITO, COMPROBAR QUE SE TRATA DE UNA PUERTA OR, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES PUESTOS TANTO A LA ENTRADA COMO A LA SALIDA, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES LOGICOS 1 Y 0 Vb Va Vs B A S 000000 055011 505101 555111 MONTAR EL CIRCUITO DE LA FIGURA, COMPROBAR QUE SE TRATA DE UNA PUERTA AND, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES OBTENIDOS A LA SALIDA, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES LOGICOS 1 Y 0 Vb Va Vs B A S 000000 050010 500100 555111 MONTAR EL CIRCUITO DEL PRIMER EJERCICIO Y BASANDOSE EN LA LOGICA NEGATIVA COMPROBAR QUE SE TRATA DE UNA PUERTA AND, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES OBTENIDOS A LA SALIDA, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES LOGICOS 1 Y 0 Vb Va Vs B A S 005001 055011 505101 550110 MONTAR EL SEGUNDO EJERCICIO Y BASANDOSE EN LA LOGICA NEGATIVA COMPROBAR QUE SE TRATA DE UNA PUERTA OR, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES OBTENIDOS A LA SALIDA, RELLENAR LA TABLA DE LA VERDAD CON LOS VALORES LOGICOS 0 Y 1 Vb Va Vs B A S

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005001 050010 500100 550110 PUERTA INVERSORA CON TRANSISTOR, EXPLICA EL COMPORTAMIENTO DEL TRANSISTOR Y RELLENA LA TABLA DE LA VERDAD CON LOS VALORES QUE OBTENGAMOS A LA SALIDA Y CON LOS VALORES LOGICOS 0 Y 1 −Cuando conectamos el transistor a +5V., saturamos el transistor y a la salida obtenemos 0V., mas cuando la entrada esta conectada a masa, a la salida obtendremos +5V. Va Vs A S Saturación corte 0 5 0 1 Ic 5mA 0A 5010 PUERTA NAND DTL, RELLENAR LA TABLA DE LA VERDAD TANTO CON LOS VALORES OBTENIDOS A LA SALIDA COMO CON LOS VALORES LOGICOS 0 Y 1 Vb Va Vs B A S 005001 055011 505101 550111 PUERTA NOR DTL, RELLENAR LA TABLA DE LA VERDAD TANTO CON LOS VALORES OBTENIDOS A LA SALIDA COMO LOS VALORES LOGICOS 0 Y 1 Vb Va Vs B A S 005001 050010 500100 550110 PUERTA OR TTL, RELLENAR LA TABLA DE LA VERDAD TANTO CON LOS VALORES OBTENIDOS A LA SALIDA COMO LOS VALORES LOGICOS 0 Y 1 Vb Va Vs B A S

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000000 055011 505101 555111 T1 Saturacion T1 Saturacion T1Corte T1 Corte T2 Saturacion T2 Corte T2 Saturacion T2 Corte Irc 4.47mA 4.36mA 4.29mA 0A

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